差别

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--- icore4tx_fpga_3 [2020/05/07 17:32]
fmj 创建
+++ icore4tx_fpga_3 [2022/04/01 11:36] (当前版本)
sean
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 |技术支持电话|**0379-69926675-801**|||
 |技术支持邮件|Gingko@vip.163.com|||
-|技术论坛|http://www.eeschool.org|||
 ^  版本  ^  日期  ^  作者  ^  修改内容  ^
 |  V1.0  |  2020-05-07  |  gingko  |  初次建立  |
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   - iCore4TX 双核心板。[[https://item.taobao.com/item.htm?spm=a1z10.1-c-s.w4004-22598974120.3.5923532fAsAtPz&id=614919247574|点击购买]]
-  - Blaster（或相同功能）仿真器。
+  - USB-CABLE（或相同功能）仿真器。
   - Micro USB线缆。
-  - Quartus开发平台。
+  - ISE开发平台。
   - 电脑一台。
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 ==== 四、引脚分配 ====
 **1、 手动分配引脚**
-、以实验二led工程为例，打开工程，如图3.1所示。
+  * 1、以实验二led工程为例，打开工程，如图3.1所示。
-{{ :icore4tx:icore4tx_fpga_3_1.png?direct&700 |图3.1}}
+{{ :icore4tx:icore4tx_fpga_3_1.png?direct&850 |图3.1}}
-、点击工具栏Tools，下拉才当中选中PlanAhead  I/O Pin Planning(PlanAhead) – Pre – Synthesis…。
+  * 2、点击工具栏Tools，下拉才当中选中PlanAhead  I/O Pin Planning(PlanAhead) – Pre – Synthesis…。
-{{ :icore4tx:icore4tx_fpga_3_2.png?direct |图3.2}}
+{{ :icore4tx:icore4tx_fpga_3_2.png?direct&850 |图3.2}}
-、如果有提示点击Yes，稍等片刻后可能会弹出欢迎界面，关闭欢迎界面，然后视图如下：
+  * 3、如果有提示点击Yes，稍等片刻后可能会弹出欢迎界面，关闭欢迎界面，然后视图如下：
-{{ :icore4tx:icore4tx_fpga_3_3.png?direct |图3.3}}
+{{ :icore4tx:icore4tx_fpga_3_3.png?direct&850 |图3.3}}
-、在I/O Ports栏下面，点击Scalar ports 前面的“+”，展开引脚列表；然后在对应引脚的Site栏选定引脚标号，完成引脚的绑定。如下图所示。
+  * 4、在I/O Ports栏下面，点击Scalar ports 前面的“+”，展开引脚列表；然后在对应引脚的Site栏选定引脚标号，完成引脚的绑定。如下图所示。
-{{ :icore4tx:icore4tx_fpga_3_4.png?direct |图3.4}}
+{{ :icore4tx:icore4tx_fpga_3_4.png?direct&850 |图3.4}}
-、分配好以后关闭该对话框，重新进行编译；如果编译无报错，则引脚分配完成。
+  * 5、分配好以后关闭该对话框，重新进行编译；如果编译无报错，则引脚分配完成。
 **2、TCL文件分配引脚**
-、还是以实验二LED实验为例，选中工程，右键点击New Source …。
+  * 1、还是以实验二LED实验为例，选中工程，右键点击New Source …。
-、新建文件类型为Implementation Constraints File，File name栏输入文件名，如下图所示，然后点击Next。
+{{ :icore4tx:icore4tx_fpga_3_5.png?direct&850 |图3.5}}
-、点击Finish。
+  * 2、新建文件类型为Implementation Constraints File，File name栏输入文件名，如下图所示，然后点击Next。
-、	可以在左侧边栏看到工程目录下多了一个.ucf格式的文件，在右边编辑区输入下图中的引脚约束信息，如图所示；引脚约束信息的语法定义如下：
+{{ :icore4tx:icore4tx_fpga_3_6.png?direct&850 |图3.6}}
-          *  NET  “端口名称”	 LOC = 引脚编号 | IOSTANDARD = “电压”
+  * 3、点击Finish。
+{{ :icore4tx:icore4tx_fpga_3_7.png?direct&850 |图3.7}}
-、点击保存，并编译工程；如果信息输入正确，编译通过，则Implement Design 前面会出现绿色“√”；则引脚分配完成。
+  * 4、可以在左侧边栏看到工程目录下多了一个.ucf格式的文件，在右边编辑区输入下图中的引脚约束信息，如图所示；引脚约束信息的语法定义如下：
+          *  **NET  “端口名称”	 LOC = 引脚编号 | IOSTANDARD = “电压”**
+{{ :icore4tx:icore4tx_fpga_3_8.png?direct&850 |图3.8}}
+  * 5、点击保存，并编译工程；如果信息输入正确，编译通过，则Implement Design 前面会出现绿色“√”；则引脚分配完成。
+{{ :icore4tx:icore4tx_fpga_3_9.png?direct&850 |图3.9}}
 ==== 五、实验步骤 ====

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