icore3_fpga_16
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icore3_fpga_16 [2020/12/18 10:02] zgf [四、代码讲解] |
icore3_fpga_16 [2022/03/18 15:44] (当前版本) sean |
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| ^ 版本 ^ 日期 ^ 作者 ^ 修改内容 ^ | ^ 版本 ^ 日期 ^ 作者 ^ 修改内容 ^ | ||
| | V1.0 | 2019-12-25 | gingko | 初次建立 | | | V1.0 | 2019-12-25 | gingko | 初次建立 | | ||
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| * 由ARM提供的数据和SCLK是同步的，那么FPGA接收数据的触发信号可以选用SCLK。阅读过STM32F407手册能够发现，它的SPI总线发送数据时，是先发送高位，再发送低位的。因此，FPGA接收到的数据也是先接收到高位数据，再接收到低位数据。这里可以采用位移操作，将数据依次存入寄存器的相应位。代码实现如下所示。 | * 由ARM提供的数据和SCLK是同步的，那么FPGA接收数据的触发信号可以选用SCLK。阅读过STM32F407手册能够发现，它的SPI总线发送数据时，是先发送高位，再发送低位的。因此，FPGA接收到的数据也是先接收到高位数据，再接收到低位数据。这里可以采用位移操作，将数据依次存入寄存器的相应位。代码实现如下所示。 | ||
| <code verilog> | <code verilog> | ||
| - | always@(posedge spi_clk or negedge rst_n) | + | always@(posedge spi_clk or negedge rst_n) |
| if(!rst_n) | if(!rst_n) | ||
| data_in<=40'd0; | data_in<=40'd0; | ||
| 行 48: | 行 47: | ||
| <code verilog> | <code verilog> | ||
| always@(posedge spi_clk or negedge rst_n) | always@(posedge spi_clk or negedge rst_n) | ||
| - | if(!rst_n) | + | if(!rst_n) |
| data<=32'd0; | data<=32'd0; | ||
| - | else if(data_in[7:0] == 8'd13)//“回车”键对应的ASCII码的值为8‘d13 | + | else if(data_in[7:0] == 8'd13)//“回车”键对应的ASCII码的值为8‘d13 |
| data<=data_in>>8;//取回车键之前的值 | data<=data_in>>8;//取回车键之前的值 | ||
| else | else | ||
icore3_fpga_16.1608256933.txt.gz · 最后更改: 2020/12/18 10:02 由 zgf
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